SEm/laboratoires/00 installation

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Le document [[Media:VHDL_syntax.pdf|VHDL_syntax.pdf]] donne quelques exemples communs de syntaxe VHDL. Tous les aspects de VHDL ne sont pas couverts et de loin. Ce document sert de pense-bête pour l'écriture de code VHDL synthétisable ainsi que pour des bancs de test.
 
Le document [[Media:VHDL_syntax.pdf|VHDL_syntax.pdf]] donne quelques exemples communs de syntaxe VHDL. Tous les aspects de VHDL ne sont pas couverts et de loin. Ce document sert de pense-bête pour l'écriture de code VHDL synthétisable ainsi que pour des bancs de test.
  
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Revision as of 10:52, 14 April 2015

Contents

Installation pour laboratoires VHDL

Répertoires

Programmes

Les programmes de développement de circuits numériques sont installés dans le répertoire C:\EDA. On y trouve notamment:

  • l'éditeur VHDL HDL-Designer
  • le simulateur VHDL Modelsim
  • les outils de synthèse pour circuits programmables Xilinx, ISE.

Sources

View-pim-tasks.png

Copiez le répertoire R:\Modules\SI\225_SEm\Digital\SEm_labs vers U:\SEm_labs.

Les fichiers source des laboratoires se trouvent dans ce répertoire. On y trouve les répertoires:

  • WaveformGenerator, SineInterpolator, Beamer, AhbLiteComponents et PipelinedOperators contenant les circuits développés,
  • WaveformGenerator_test, SineInterpolator_test, Beamer_test, AhbLiteComponents_test et PipelinedOperators_test contenant les bancs de test,
  • Board contenant la logique nécessaire à la réalisation du circuit sur la plaque de laboratoire (inversions, synchronisation, ...),
  • Simulation contenant les définitions de présentation des signaux dans le simulateur.

Fichiers locaux

Les librairies et les fichiers temporaires (code compilé, ...) sont générés dans le répertoire local C:\Temp\EDA\<username>\<projectname>.

Documentation

Syntaxe VHDL

La bibliothèque de l'école compte plusieurs ouvrages détaillant la syntaxe de VHDL.

Le document VHDL_syntax.pdf donne quelques exemples communs de syntaxe VHDL. Tous les aspects de VHDL ne sont pas couverts et de loin. Ce document sert de pense-bête pour l'écriture de code VHDL synthétisable ainsi que pour des bancs de test.


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Arrow left.gif - Arrow up.gif Travaux de laboratoire 01 Générateur des fonctions Arrow right.gif

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