SEm/laboratoires/08 soc
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Le [http://opencores.org/project,nanoblaze processeur] exécute un programme qui lit l'interface série, à travers le périphérique UART et donne accès au contenu de la mémoire en lecture ou en écriture. | Le [http://opencores.org/project,nanoblaze processeur] exécute un programme qui lit l'interface série, à travers le périphérique UART et donne accès au contenu de la mémoire en lecture ou en écriture. | ||
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Le protocole série est celui utilisé par les collègues d'électronique de puissance pour la communication avec leurs DSPs. | Le protocole série est celui utilisé par les collègues d'électronique de puissance pour la communication avec leurs DSPs. | ||
Chaque trame se compose comme suit: | Chaque trame se compose comme suit: | ||
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| − | : checksum: somme de tous les bytes de la commande, en ignorant les reports | + | : '''checksum''': somme de tous les bytes de la commande, en ignorant les reports |
Chaque commande reçoit en retour une trame qui se construit de la même façon. | Chaque commande reçoit en retour une trame qui se construit de la même façon. | ||
| − | La réponse retourne le même numéro que la commande | + | La réponse retourne le même numéro et le même code que la commande, mais avec des données différentes. |
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Le banc de test à disposition, <code>beamerSoc_tb</code>, lit et écrit dans différents registres du système. | Le banc de test à disposition, <code>beamerSoc_tb</code>, lit et écrit dans différents registres du système. | ||
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| − | + | Examinez le contenu du bloc <code>beamerSoc</code> | |
| + | et déterminer à quelles adresses sont les registres du périphérique de dessin de courbes. | ||
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| − | + | Etudier le code VHDL du générateur de stimuli <code>beamerSoc_tester</code> et expliquer la séquence de test. | |
| − | et expliquer la séquence de test. | + | |
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Revision as of 11:54, 14 April 2015
Contents |
System on Chip (SoC)
Introduction
Dans ce laboratoire, nous allons implémenter dans un circuit programmable un système à processeur comprenant les périphériques développés précédemment.
Protocole bus série
Le processeur exécute un programme qui lit l'interface série, à travers le périphérique UART et donne accès au contenu de la mémoire en lecture ou en écriture.
Trames
Le protocole série est celui utilisé par les collègues d'électronique de puissance pour la communication avec leurs DSPs. Chaque trame se compose comme suit:
- header: AAh
- packet id: numéro de la commande
- cmd: code de commande
- data length: nombre de bytes du contenu de la commande
- data: contenu de la commande
- checksum: somme de tous les bytes de la commande, en ignorant les reports
Chaque commande reçoit en retour une trame qui se construit de la même façon. La réponse retourne le même numéro et le même code que la commande, mais avec des données différentes.
Simulation
Le banc de test à disposition, beamerSoc_tb, lit et écrit dans différents registres du système.
Implémentation
Navigation
07 Périphérique de dessin de courbes pour bus AMBA
Travaux de laboratoire
09 Additionneur pipeline 
