SEm/labore/00 installation

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m (VHDL Syntax)
 
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=== Programme ===
 
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Die Programme zum Entwurf von digitalen Schaltungen sind installiert im Verzeichnis
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Die Programme zum Entwurf von digitalen Schaltungen im Verzeichnis
'''C:\EDA'''. Es befinden sich da unter anderen:
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<code>C:\EDA</code> installiert. Es befinden sich da unter anderem:
  
* der VHDL Editor '''HDS''',
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* der VHDL Editor '''HDL-Designer''',
* der VHDL Simulator '''Modelsim''',
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* der VHDL Simulator '''ModelSim''',
* dies Synthese-Tools f&uuml;r die Xilinx programmierbaren Schaltungen, '''ISE'''.
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* das Synthese-Tools für die programmierbaren Schaltungen von Xilinx, '''ISE'''.
  
 
=== Sources ===
 
=== Sources ===
  
Die Source-Dateien f&uuml;r die Labore befinden sich im Prinzip unter
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'''U:\SEm_labs'''. Es befinden sich da unter anderen:
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Kopieren Sie die Datei <code>R:\SYND\SEm_225\3_Labos\Labos_cof\HEUS_SEm_labs.bat</code> nach <code>U:\SEm_labs</code> und führen Sie diese aus.}}
  
* '''WaveformGenerator''', '''SineInterpolator''' et '''Beamer''' mit den entworfenen Schaltungen,
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In diesem Ordner befinden sich die Quelldateien für die Labore in, unter anderem, folgenden Verzeichnissen:
* '''WaveformGenerator_test''', '''SineInterpolator_test''' et '''Beamer_test''' mit den Testbanken,
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* '''Board''' mit der Logik zur Erstellung der Schaltung auf die Laborplatten (Inverter, Synchronisation, ...),
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* '''Simulation''' mit den Dateien, welche die Anordnung der Signale f&uuml;r die Simulation definieren.
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Wenn dies Verzeichnisse anderswo gelegt werden, so m&uuml;ssen die Einstellungsdateien
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* '''WaveformGenerator''', '''SineInterpolator''' und '''Beamer''' mit den entworfenen Schaltungen,
korrigiert werden, insbesondere das Link '''HDL Designer'''.
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* '''WaveformGenerator_test''', '''SineInterpolator_test''' und '''Beamer_test''' mit den Testbanken,
 
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* '''Board''' mit der Logik zur Erstellung der Schaltung auf den Laborschaltkreisen (Inverter, Synchronisation, ...),
Kopieren Sie das Verzeichnis '''R:\Modules\SI\223_SEm\Digital\SEm_labs'''
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* '''Simulation''' mit den Dateien, welche die Anordnung der Signale für die Simulation definieren.
zu '''U:\SEm_labs''' .
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=== Lokale Dateien ===
 
=== Lokale Dateien ===
  
Die Libraries und die tempor&auml;re Dateien (compiliertes Code, ...) sind im lokalen
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Die Bibliotheken und die temporäre Dateien (kompilierter Code, ...) werden im lokalen Verzeichnis <code>C:\Temp\EDA\<username>\<projectname></code> generiert.
Verzeichnis '''My Documents\Tmp'''.
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== Dokumentation ==
 
== Dokumentation ==
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=== VHDL Syntax ===
 
=== VHDL Syntax ===
  
Die Bibliothek des Schule z&auml;hlt mehrere B&uuml;cher, die die VHDL-Syntax im einzelnen
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Die Schulbibliothek hält mehrere Bücher, die die VHDL-Syntax im Detail beschreiben, zum Ausleihen bereit.
beschreiben.
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Das HTML Dokument '''R:\Modules\SI\223_SEm\Digital\VHDL\VHDL
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Das Dokument [[Media:VHDL_syntax.pdf|VHDL_syntax.pdf]] gibt einige allgemeine VHDL Syntaxbeispiele. Es werden mit Abstand nicht alle Aspekte von VHDL abgedeckt. Dieses Dokument ist als Nachschlagewerk für das Schreiben von synthetisierbarem VHDL-Code sowie Testbänken gedacht.
syntax\index.HTML''' gibt einige gemeinsame VHDL Syntaxbeispiele. Alle Aspekte von
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VHDL werden mit Abstand nicht abgedeckt. Dieses Dokument dient als Hilfe f&uuml;r das Schreiben
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von synthetisierbarem VHDL-Code sowie f&uuml;r Testb&auml;nke.
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[[Category:SEm]]
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[[Category:Bachelor]][[Category:SEm]][[Category:Deutsch]]

Latest revision as of 10:25, 16 February 2018

Contents

Installation für VHDL Labore

Verzeichnisse

Programme

Die Programme zum Entwurf von digitalen Schaltungen im Verzeichnis C:\EDA installiert. Es befinden sich da unter anderem:

  • der VHDL Editor HDL-Designer,
  • der VHDL Simulator ModelSim,
  • das Synthese-Tools für die programmierbaren Schaltungen von Xilinx, ISE.

Sources

View-pim-tasks.png

Kopieren Sie die Datei R:\SYND\SEm_225\3_Labos\Labos_cof\HEUS_SEm_labs.bat nach U:\SEm_labs und führen Sie diese aus.

In diesem Ordner befinden sich die Quelldateien für die Labore in, unter anderem, folgenden Verzeichnissen:

  • WaveformGenerator, SineInterpolator und Beamer mit den entworfenen Schaltungen,
  • WaveformGenerator_test, SineInterpolator_test und Beamer_test mit den Testbanken,
  • Board mit der Logik zur Erstellung der Schaltung auf den Laborschaltkreisen (Inverter, Synchronisation, ...),
  • Simulation mit den Dateien, welche die Anordnung der Signale für die Simulation definieren.

Lokale Dateien

Die Bibliotheken und die temporäre Dateien (kompilierter Code, ...) werden im lokalen Verzeichnis C:\Temp\EDA\<username>\<projectname> generiert.

Dokumentation

VHDL Syntax

Die Schulbibliothek hält mehrere Bücher, die die VHDL-Syntax im Detail beschreiben, zum Ausleihen bereit.

Das Dokument VHDL_syntax.pdf gibt einige allgemeine VHDL Syntaxbeispiele. Es werden mit Abstand nicht alle Aspekte von VHDL abgedeckt. Dieses Dokument ist als Nachschlagewerk für das Schreiben von synthetisierbarem VHDL-Code sowie Testbänken gedacht.


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